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  6. FPGA和CPLD的區(qū)別詳解
    • 發(fā)布時(shí)間:2022-02-17 18:47:37
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    FPGA和CPLD的區(qū)別詳解
    FPGA是現(xiàn)場(chǎng)可編程邏輯門(mén)陣列的簡(jiǎn)稱(chēng),是電子設(shè)計(jì)的一個(gè)里程碑。CPLD是復(fù)雜可變成邏輯器件的簡(jiǎn)稱(chēng)。雖然FPGA和CPLD都是可編程ASIC器件,在一定的層度上具有很大的相似性,但也有很多不同之處,因?yàn)楦髯缘慕Y(jié)構(gòu)不同,讓它們都各有特點(diǎn)。下面將介紹這兩者的區(qū)別:
    CPLD
    CPLD
    1.概念區(qū)別:(1)FPGA(Field-Programmable Gate Array),即現(xiàn)場(chǎng)可編程門(mén)陣列,它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。它是作為專(zhuān)用集成電路(ASIC)領(lǐng)域中的一種半定制電路而出現(xiàn)的,既解決了定制電路的不足,又克服了原有可編程器件門(mén)電路數(shù)有限的缺點(diǎn)。
    (2)CPLD(Complex Programmable Logic Device)復(fù)雜可編程邏輯器件,是從PAL和GAL器件發(fā)展出來(lái)的器件,相對(duì)而言規(guī)模大,結(jié)構(gòu)復(fù)雜,屬于大規(guī)模集成電路范圍。是一種用戶(hù)根據(jù)各自需要而自行構(gòu)造邏輯功能的數(shù)字集成電路。其基本設(shè)計(jì)方法是借助集成開(kāi)發(fā)軟件平臺(tái),用原理圖、硬件描述語(yǔ)言等方法,生成相應(yīng)的目標(biāo)文件,通過(guò)下載電纜(“在系統(tǒng)”編程)將代碼傳送到目標(biāo)芯片中,實(shí)現(xiàn)設(shè)計(jì)的數(shù)字系統(tǒng)。
    2.在編程方式上,CPLD主要是基于E2PROM或FLASH存儲(chǔ)器編程,編程次數(shù)可達(dá)1萬(wàn)次,優(yōu)點(diǎn)是系統(tǒng)斷電時(shí)編程信息也不丟失。CPLD又可分為在編 程器上編程和在系統(tǒng)編程兩類(lèi)。FPGA大部分是基于SRAM編程,編程信息在系統(tǒng)斷電時(shí)丟失,每次上電時(shí),需從器件外部將編程數(shù)據(jù)重新寫(xiě)入SRAM中。其 優(yōu)點(diǎn)是可以編程任意次,可在工作中快速編程,從而實(shí)現(xiàn)板級(jí)和系統(tǒng)級(jí)的動(dòng)態(tài)配置。
    3.CPLD更適合完成各種算法和組合邏輯,F(xiàn)PGA更適合于完成時(shí)序邏輯。換句話(huà)說(shuō),F(xiàn)PGA更適合于觸發(fā)器豐富的結(jié)構(gòu),而CPLD更適合于觸發(fā)器有限而乘積項(xiàng)豐富的結(jié)構(gòu)。
    4.CPLD的連續(xù)式布線(xiàn)結(jié)構(gòu)決定了它的時(shí)序延遲是均勻的和可預(yù)測(cè)的,而FPGA的分段式布線(xiàn)結(jié)構(gòu)決定了其延遲的不可預(yù)測(cè)性。
    5.在編程上FPGA比CPLD具有更大的靈活性。CPLD通過(guò)修改具有固定內(nèi)連電路的邏輯功能來(lái)編程,F(xiàn)PGA主要通過(guò)改變內(nèi)部連線(xiàn)的布線(xiàn)來(lái)編程;FPGA可在邏輯門(mén)下編程,而CPLD是在邏輯塊下編程。
    6.CPLD比FPGA使用起來(lái)更方便。CPLD的編程采用E2PROM或FASTFLASH技術(shù),無(wú)需外部存儲(chǔ)器芯片,使用簡(jiǎn)單。而FPGA的編程信息需存放在外部存儲(chǔ)器上,使用方法復(fù)雜。
    7.CPLD的速度比FPGA快,并且具有較大的時(shí)間可預(yù)測(cè)性。這是由于FPGA是門(mén)級(jí)編程,并且CLB之間采用分布式互聯(lián),而CPLD是邏輯塊級(jí)編程,并且其邏輯塊之間的互聯(lián)是集總式的。
    8.FPGA的集成度比CPLD高,具有更復(fù)雜的布線(xiàn)結(jié)構(gòu)和邏輯實(shí)現(xiàn)。
    9.CPLD保密性好,F(xiàn)PGA保密性差。
    10.一般情況下,CPLD的功耗要比FPGA大,且集成度越高越明顯。
    以上就是FPGA與CPLD的區(qū)別介紹了。綜上所述,F(xiàn)PGA和CPLD最大的區(qū)別是它們的存儲(chǔ)結(jié)構(gòu)不一樣,這同時(shí)也決定了它們的規(guī)模不一樣。但是從使用和實(shí)現(xiàn)的角度來(lái)看,其實(shí)它們所使用的語(yǔ)言以及開(kāi)發(fā)流程的各個(gè)步驟幾乎是一致的。
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